對於 Itanium現有的用戶來說，這樣的升級到底算是一劑強心針還是跟笑話差不多實在是很難判斷。Intel昨天宣佈正式推出代號為 Montvale的新一代 Itanium處理器 9100系列。比起前一代的 Montecito，Montvale的最高時脈速度從 1.6Ghz提升到 1.66Ghz。你的眼睛沒有看錯，9100系列的 Itanium只比前一代 9000系列在時脈速度上提昇 0.06Ghz。
其實在更早之前的 Intel產品藍圖上，Montvale的時脈速度應該是要到達 3.0Ghz以便和 IBM Power 6互相抗衡的。只不過 Intel在考量 X86伺服器處理器市場遠比 Itanium的存亡重要之後，大部分的心力都花在用來對付 AMD Opteron上面。對於已經花大筆錢投資在 Itanium伺服器的客戶，就給它小小升級個 0.06Ghz也算是有個交待了。
當然，Intel會告訴你 Montvale有一些了不起的新功能，例如新的 RAS容錯功能 Core Level Lock-Step還有前端匯流排的速度從 533Mhz提升到 667Mhz等等。不過這些東西在技術上似乎也不算太大的突破。
最可恥的是，Intel宣稱支援 Itanium的應用軟體已經增加到超過一萬兩千個。一個根本沒什麼人用的平台為甚麼會有這麼多軟體廠商支援呢？原來，Intel指的是它和 Transivtive這家軟體公司合作，推出了可以讓 Solaris/SPARC以及 z/OS平台的軟體，直接在 Linux/Itanium上面執行的模擬軟體。所以只要是能夠在 Solaris/SPARC和 z/OS上面執行的軟體，都可以算是支援 Itanium平台。這樣加一加，就變成一萬兩千個了。
看到 Intel推出這樣的升級，如果我是 Itanium用戶企業裡面的老闆，我一定會把當初決定採用 Itanium平台的主管炒魷魚。
http://www.theregister.co.uk/2007/10/31/intel_montvale_itanium/
14 則留言:
事實上，Montvale只是debug後的Montecito，本來就不值得過度期望。
不過，Core lock-step並不是好做的東西，技術難度頗高。
至於Montvale時脈到達3GHz？我看了Intel roadmap這麼多年，從來沒有得知這種訊息，蠻好奇資料來源是哪來的。
其他的....完全不予置評，反正時間會證明一切。
關於 Montvale原本應該可以跑到 3Ghz的報導可以參考這篇文章：
http://www.theregister.co.uk/2007/08/02/intel_montvale_itanium/
老實說，這篇文章簡直都是胡說八道。連Tukwila的目標時脈都沒2.5GHz了，Montvale能到3GHz？
Intel過去就講的很清楚，Montvale的目標是"2GHz"，Montecito/Montvale也不是高時脈設計，這不必別人講，有點sense一看就知道。
至於Intel為何要推Montvale？其實也就只是「完整版」的Montecito，稱不上什麼升級，看在lock-step的分上，我倒是覺得這東西比較有可能是為了HP NonStop而做的。
反正看原文作者的名字....唉，算了。
也對， 時間會證明一切。
debug後的東西？換言話說， 之前的CPU沒有debug...無言。
Corelock-setp不是好做的東西，不過Intel也不是剛成立的小公司。說法有點太徧了點。
Intel在Montecito上導入了很多激進的設計，特別是超大型L3 cache的容錯機制和動態調整時脈的Demand-based switching。Montecito就因為DBS搞不定（電路設計問題頗多），才會延期半年、外加出貨時被迫關掉DBS和降低FSB。
所以我才說Montvale是「debug」過的Montecito，DBS和667MHz FSB都復活了。
請別忘了，Montecito/Montvale是單晶粒超過十七億電晶體，而且需要高可靠性的怪物。同樣的情況也發生在延期一年的IBM Power6身上。
至於core lock-step好不好作？這完全就是經驗問題（要徹底同步兩個核心所有的指令執行流程是很困難的工作），很不幸的，Intel就真的沒有這方面的經驗。就算是IBM，現在zSeries和pSeries也不是採用這種花錢的作法，這東西大概就是為了HP NSK做的。
我是覺得太多人根本就對Itanium/IA-64的歷史和高階伺服器市場的生態一無所知，隨隨便便就亂罵一通。最起碼，Itanium現在在高階伺服器市場的佔有率已經相當的高，Intel也等於是在替無力研發高階CPU的伺服器廠商作慈善事業，完全無利可圖。
如果沒有Intel，這市場早就都是IBM/Sun獨占的局面，不過很多整天把「開放」掛在嘴邊的人，似乎都搞不懂這一點。
超過十七億的電晶體, 其實很多都是拿來作cache, 第二, Itanium不光是Intel自己人組成, 之前的HP team/Alpha team也在其中, 別把沒經驗掛在嘴上醣塞, 一點意義也沒有.
Intel也不是做慈善事業, 到頭來只是想後面再拿回來而己. 別自己以為是, 井底觀天, 只是該人覺得可笑而己.
IBM/Sun獨佔高階主機, 就好比Intel壟斷PC市場一樣. 狗咬狗, 還不都是一嘴毛.
其實Pellston原本還是IBM發明的名詞，只是沒想到竟然第一個發揚光大的卻是Intel。千萬別小看兩位數MB的on-die cache，要維持這麼大容量SRAM的可靠度，背後需要很驚人的技術能量。
事實上，IBM自己也作不到這樣的水準。
另外，關於core lock-step，經驗當然很重要，有興趣請詳列作過的廠商，而且還是硬體手段（還不是NSK之類的軟體途徑），HP？DEC？在哪裡呀？就知道這東西的門檻有多高。更重要的是，和DBS不同，這功能並不是Montecito的預設目標，而完全是Montvale追加的功能。
Intel這十年來，為了Itanium搞走了一堆高階主管，自己也是被逼著硬撐下去。道理很簡單，因為根本無利可圖，但又為了維持對其他廠商與企業的承諾，不得不守住這條產品線。
我知道這個blog的corey很喜歡去講「IDC一年260億美元」之類的樂觀預期，講的好像Intel吞光這筆錢的樣子，但就算這樣，那又如何？
越高階的server，CPU所佔的成本比例是越低的（最高的反而是儲存系統），一般來說差不多是1/10，所以IDC當年的樂觀預估成真好了，Intel又不可能自己賣整套系統，system infrastructure和服務也不可能插手，一年在Itanium的營收，也頂多20-30億美元，投資報酬完全不成比例。
一台裝滿128顆Montecito的HP Superdome，標準售價大概接近兩億台幣，然後Montvale最高階的9150M，「每一千顆平均檯面價格（實際上更低）」是3692美元，其他的部份，Intel完全無權置喙，請算一下，Intel能賺多少？
所以Intel除了可以將Itanium當作「先進技術的實驗載具」外，完全無利可圖。
至於我是否「以井觀天」，我前一份工作寫過一點東西，有空倒是可以看看。
http://www.ithome.com.tw/itadm/article.php?c=38381
http://www.ithome.com.tw/plog/index.php?op=ViewArticle&articleId=4490&blogId=24
狗眼看人低也請有個限度，謝謝。
有人有真的用過嗎? 不會都是紙上談兵或人云亦云?
想問問各位師兄, 何為core lock-step, 而上市多時的AMD Opteron 及 Intel Core 2 Duo, 是否一樣做得唔好呢?
core level lock-stepping的基本原理是：兩個不同的處理器或處理器核心同時執行一樣的指令及運算動作，包含cache及register等存取均完全同步，相互比對，如果兩邊一有不同，就必須重來一次。
換言之，如果指令集架構和處理器的微架構越單純，就越容易導入core level lock-stepping，反之亦同。x86？謝謝，請有空再聯絡。
當然，這功能不見得非得用硬體實作不可，像HP NonStop Kernel和NEC/Stratus就是透過軟體手段來比對不同處理器/伺服器節點的運算結果，再藉由統計數據稽核哪些部份有問題，必須關閉。不過，直接做在處理器內，當然會更加可靠。
反倒是追求高時脈、管線結構複雜的高階處理器，像IBM Power6和剛發表的z6等，就不易實作這樣堅壁清野的底層RAS功能（IBM的Charles Webb在之前的IEEE HotChips就承認這點），所以IBM也改弦易轍，採用其他手段改進可靠度。
所以我才說，這功能看起來很簡單，做起來可不是這麼一回事。
看到「core level lock-stepping的基本原理是：兩個不同的處理器或處理器核心同時執行一樣的指令及運算動作，包含cache及register等存取均完全同步，相互比對，如果兩邊一有不同，就必須重來一次。 ... 所以我才說，這功能看起來很簡單，做起來可不是這麼一回事。」，就想到哈林之前的歌...
「嘿！蛋炒飯~ 最簡單也最麻煩！飯要粒粒分開，還要包著蛋！」
不是狗眼看人低, 是狗眼看"賤"狗低...
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